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--- projects:maps21:mess:l6:l6 [2024/04/05 14:50]
carsten
+++ projects:maps21:mess:l6:l6 [2024/04/06 10:28] (current)
carsten [Korrigiertes Timing]
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 | {{:projects:maps21:mess:l6:timing_astabil_1ms.png?direct&500|Timing 1ms-Pulse astabil}}\\ Hier ist nur der astabile Schaltungsteil für die 1ms Takte dargestellt.   | {{:projects:maps21:mess:l6:anfang-20ms-intervall.png?direct&200|Anfang}}  | {{:projects:maps21:mess:l6:tek00161.png?direct&600|20 ms}}  |
-**Mit den hier eingestellten RC-Kombinationen erhält man aus der AC-Phase des Steckernetzteiles getriggerte 19,5 µs Zeitintervalle. Darin sind dann dann die Millisekundeintervalle generiert, die die Anzeige benötigt.** Warum sind das nun 28 Pulse und nicht nur die 20 anvisierten?\\
+Für den das UNILAC-Timing als negativem Sinus ließt man ab, dass die Triggerung des 20ms-Intervalles bei einer Spannung von +8V geschieht, also etwas zu früh. Der Phasenwinkel dafür ergibt sich aus 8V = - 18 V sin(α) ⇒ α = - 26,4° (< 5min auf 1h). Das lässt sich am Komperator noch tunen!
+**Mit den hier eingestellten RC-Kombinationen erhält man aus der AC-Phase des Steckernetzteiles getriggerte 19,5 µs Zeitintervalle. Darin sind dann dann die Millisekundenintervalle generiert, die die Anzeige benötigt.** Warum sind das nun 28 Pulse und nicht nur die 20 anvisierten?\\
 Man ließt ab, dass der erste 1ms-Takt genau diese Länge hat, aber das Zweite und die Folgenden dann nur noch 666 µs, also 2/3 s Länge haben. Da die Folgetakte also kürzer sind gibt es eben 28 statt 20 Pulse! Der erste Puls beginnt, wenn das Low der Vorstufe als /RESET der Zweiten durch das High des 20ms-Taktes ersetzt und der astabile Vibrator freigegeben wird: Die Spannung am zeitbestimmenden Kondensator startet dann bei 0 V und steigt bis zu Erreichen von 2/3 der Betriebsspannung (+5V) an, das NAND-Flipflop wird rückgesetzt:\\ \\
 **1.)**  Wird dann der Threshold überschritten, dann werden das NAND-Flipflop und der Ausgang nach Treibern deaktiviert. Der Dischargetransistor schaltet den Eingangsknoten gegen Ground durch, die Kapazität C wird entladen, wobei der Entladeprozess kurz ist und nur durch den Serienwiderstand der Kapazität limitiert wird.\\

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