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projects:maps21:s:ext:extend [2023/08/07 11:27] carsten |
projects:maps21:s:ext:extend [2024/03/08 10:17] (current) carsten [Fehler im Design] |
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| 3 | 50 Ohm Abschlusswiderstände in 0805 Layoutet, aber größer gekauft | | 3 | 50 Ohm Abschlusswiderstände in 0805 Layoutet, aber größer gekauft | ||
| 4 | Buchsenleiste statt Stiftleiste | Die fälschlich eingesetzte Buchsenleiste bringt den Pin 1 an die falsche Stelle, nach unten. Gewollt ist aber eine Stiftleiste mit Pin1 oben! | Die Stiftleiste wird eingesetzt: Pin 1 ist oben und wird entsprechend mit dem Flachband angefahren (braune Ader), entgegen der Dreiecksmarkierung! | | 4 | Buchsenleiste statt Stiftleiste | Die fälschlich eingesetzte Buchsenleiste bringt den Pin 1 an die falsche Stelle, nach unten. Gewollt ist aber eine Stiftleiste mit Pin1 oben! | Die Stiftleiste wird eingesetzt: Pin 1 ist oben und wird entsprechend mit dem Flachband angefahren (braune Ader), entgegen der Dreiecksmarkierung! | ||
- | | 5 | +15V von Klemme zu J1-innen, aber nicht J2-aussen (SubDback)! | + | | 5 | -15V von Klemme zu J1-innen, aber nicht J2-aussen (SubDback)! |
| 6 | GND-Anbindung bisher extern | | 6 | GND-Anbindung bisher extern | ||
| 7 | Am Komparator fehlt der 100nA Stützkondensator für VCC | Datenblatt empfiehlt nahen Stützkondensator | | 7 | Am Komparator fehlt der 100nA Stützkondensator für VCC | Datenblatt empfiehlt nahen Stützkondensator | ||
- | | 8 | Wg. UNILAC = -sin() ist Out- fasch. | Der Timer wird fallend getriggert und da ser Takt ein neg. Sinus ist, muss der positive Ausgang | + | | 8 | Wg. UNILAC = -sin() ist Out- falsch. | Der Timer wird fallend getriggert und da der Takt ein neg. Sinus ist, muss der positive Ausgang |
===== Hysterese ===== | ===== Hysterese ===== |